eminfedar / fedar-f1-rv64im
5-Stage Pipelined RV64IM RISC-V CPU design in Verilog.
☆204Updated 3 years ago
Alternatives and similar repositories for fedar-f1-rv64im
Users that are interested in fedar-f1-rv64im are comparing it to the libraries listed below
Sorting:
- 5-Stage Pipelined RV32I RISC-V Core design in Verilog-2005. It has 32 GPIO pins and it is FPGA synthesible.☆23Updated 2 years ago
- KASIRGA - KIZIL Takımı Teknofest 2023 Çip Tasarımı - KIZIL İşlemci Projesi☆150Updated last year
- Bu depo TEKNOFEST 2023 Çip Tasarım Yarışması'nda Analog Tasarım ve Sayısal İşlemci Tasarımı kategorilerinde çeşitli dosyaları paylaşmak i…☆21Updated 2 years ago
- Kasırga - Gök Sayısal İşlemci Kategorisi RISC-V İşlemci Tasarımı☆14Updated last year
- "Mehmet Burak Aykenar" YouTube kanalında yayınlanan VHDL ve FPGA dersleri ile ilgili kodları içermektedir.☆101Updated 11 months ago
- Kasırga Sayısal Görüntü İşleme Kategorisi Hızlandırıcı Tasarımı☆12Updated last year
- This course is given in ERCIYES UNIVERSITY for Spring 2022-2023 semester as a fourth grade lecture. You can find lecture notes, RISC-V as…☆16Updated last year
- RISC-V RV32IM cpu circuit in Logisim Evolution.☆26Updated 3 years ago
- KASIRGA-GUN | RV32IMCX☆12Updated 9 months ago
- Repository of FPGA from Zero to Hero - Live and Free FPGA/SoC Lectures on YouTube (www.youtube.com/@falsepaths)☆33Updated last month
- 64-bit RISC-V processor☆16Updated 2 years ago
- Yonga-MCU is a 32-bit RISCV-IMC instruction set compatible SoC design with peripherals like UART, SPI and I2C☆17Updated 2 years ago
- PCIe GEN1, GEN2 and GEN3 Scrambler, This Scrambler is able to scramble 1,2 and 4 bytes of data in 1 clock cycle in respect to the scrambl…☆13Updated 5 months ago
- This course is given in TOBB ETU for Fall 2022-2023 semester as a second grade lecture. You can find lecture notes and Verilog codes rela…☆49Updated 2 years ago
- 5 Stage Pipelined RISC V Processor Design for RV32I Instruction Set☆10Updated 2 years ago
- Sistem Programlama Türkçe Kaynak (KTÜ)☆56Updated 5 years ago
- Istanbul Technical University. Lecture notes, homeworks, exams etc.☆69Updated last year
- Python ile en verimli izin günlerini tespit edin.☆88Updated 6 months ago
- ☆13Updated last year
- Building a busybox based RiscV 64-bit GNU/Linux system from scratch☆50Updated 5 years ago
- Basic RISC-V Test SoC☆122Updated 6 years ago
- TCDD Bilet Yer Var mı Yok Mu Kontrol Etme☆127Updated 2 years ago
- Rust dilini en temelden basit örneklerle anlatan, derslerde kullanılmak üzere hazırlanmış açık kaynak slaytlardır.☆57Updated last year
- 2017-2021 Sakarya Üniversitesi Bilgisayar Mühendisliği Bölümü ders notları, sınavlar, kod örneklerini içermektedir.☆185Updated 2 years ago
- acik-kaynak.org 1.0☆111Updated 2 years ago
- ☆24Updated 3 years ago
- This is full tutorial of UVM (Universal Verification Methodology) for a simple ALU unit☆24Updated 6 years ago
- Tasarım desenlerinin aşırı basitleştirilmiş Türkçe açıklamaları☆113Updated 3 years ago
- Bu repo paulgraham.com adresindeki denemelerin Turkceye cevrilmis hallerinin yayinladigi gonulluluk ile buyuyen bir kaynaktir.☆285Updated last year
- Pipelined RISC-V CPU☆23Updated 3 years ago