serge0699 / synth_school_verif_tasksLinks
Репозиторий заданий и примеров направления функциональной верификации Школы синтеза цифровых схем
☆21Updated 8 months ago
Alternatives and similar repositories for synth_school_verif_tasks
Users that are interested in synth_school_verif_tasks are comparing it to the libraries listed below
Sorting:
- Открытый ознакомительный к урс "Введение в функциональную верификацию RISC-V ядер"☆45Updated last month
- Открытое RISC-V процессорное ядро MIRISCV для образовательных целей☆23Updated last year
- SystemVerilog language-oriented exercises☆53Updated this week
- SystemVerilog language-oriented exercises☆135Updated 2 weeks ago
- Полезные ресурсы по тематике FPGA / ПЛИС☆174Updated last month
- FPGA exercise for beginners☆146Updated this week
- Репозиторий факультатива по функциональной верификации НИУ МИЭТ☆13Updated last year
- ☆48Updated 4 years ago
- DigitalDesignSchool2022/23 repository☆21Updated 3 years ago
- Исходные коды к главам книги "Цифровой синтез: практический курс" (под ред. А.Ю. Романова и Ю.В. Панчула)☆61Updated 2 years ago
- CPU microarchitecture, step by step☆185Updated 3 years ago
- Методические материалы курса "Практикум по ПЛИС"☆40Updated 6 months ago
- FPGA exercise for beginners☆42Updated last month
- Control and Status Register map generator for HDL projects☆128Updated 6 months ago
- human-in-the-loop HDL training tool☆40Updated last year
- Архитектуры процессорных систем (старый репозиторий, ранее размещавшийся по адресу github.com/MPSU/APS)☆95Updated last year
- Verilog digital signal processing components☆161Updated 3 years ago
- Repository gathering basic modules for CDC purpose☆56Updated 5 years ago
- Static Timing Analysis Full Course☆62Updated 2 years ago
- ☆170Updated 3 years ago
- open-source Ethenet media access controller for Ariane on Genesys-2☆19Updated 6 years ago
- Contains source code for sin/cos table verification using UVM☆21Updated 4 years ago
- ☆76Updated 3 years ago
- Developed with the aim of providing engineers and designers with a centralized resource, this repository serves as a valuable reference f…☆64Updated last year
- UART implementation using verilog☆25Updated 2 years ago
- Учебные материалы Альянса RISC-V☆14Updated 5 months ago
- AHB3-Lite Interconnect☆107Updated last year
- SDRAM controller for MIPSfpga+ system☆24Updated 5 years ago
- Verilog based BCH encoder/decoder☆128Updated 3 years ago
- Материалы по курсу Углубленное изучение языка С (факультатив) для студентов МИЭТ☆12Updated 10 months ago