RomeoMe5 / DDLMLinks
Исходные коды к главам книги "Цифровой синтез: практический курс" (под ред. А.Ю. Романова и Ю.В. Панчула)
☆59Updated last year
Alternatives and similar repositories for DDLM
Users that are interested in DDLM are comparing it to the libraries listed below
Sorting:
- CPU microarchitecture, step by step☆181Updated 3 years ago
- SystemVerilog language-oriented exercises☆47Updated 2 weeks ago
- DigitalDesignSchool2022/23 repository☆19Updated 2 years ago
- FPGA exercise for beginners☆37Updated this week
- ChipEXPO 2020 Digital Design School Labs☆36Updated 2 years ago
- Архитектуры процессорных систем (старый репозиторий, ранее размещавшийся по адресу github.com/MPSU/APS)☆94Updated last year
- FPGA exercise for beginners☆119Updated 3 weeks ago
- Полезные ресурсы по тематике FPGA / ПЛИС☆165Updated 8 months ago
- Методические материалы по разработке процессора архитектуры RISC-V☆246Updated this week
- Открытый ознакомительный курс "Введение в функциональную верификацию RISC-V ядер"☆42Updated last week
- ☆48Updated 3 years ago
- Материалы для курсов по проектированию цифровых вычислительных систем☆96Updated 3 months ago
- Репозиторий заданий и примеров направления функциональной верификации Школы синтеза цифровых схем☆20Updated 3 months ago
- SystemVerilog language-oriented exercises☆101Updated 2 weeks ago
- Verilog implementation of RISC-V: RV32IAC plus much of B. 32-bit or 16-bit bus.☆25Updated last year
- Verilog (SystemVerilog) coding style☆42Updated 6 years ago
- ☆24Updated 5 years ago
- CPU microarchitecture, step by step☆198Updated 4 years ago
- Репозиторий факультатива по функциональной верификации НИУ МИЭТ☆13Updated 10 months ago
- Открытое RISC-V процессорное ядро MIRISCV для образовательных целей☆19Updated 7 months ago
- open-source SDKs for the SCR1 core☆73Updated 8 months ago
- human-in-the-loop HDL training tool☆38Updated last year
- ☆43Updated 3 weeks ago
- Методические материалы курса "Практикум по ПЛИС"☆32Updated last month
- Учебные материалы Альянса RISC-V☆14Updated 2 weeks ago
- MIPSfpga+ allows loading programs via UART and has a switchable clock☆109Updated 6 years ago
- Digital Design Labs☆24Updated 6 years ago
- Fully pipelined Integer Scaled / Unscaled Radix-2 Forward/Inverse Fast Fourier Transform (FFT) IP-core for newest Xilinx FPGAs (Source la…☆88Updated 2 years ago
- A small RISC-V core (SystemVerilog)☆32Updated 5 years ago
- SDRAM controller for MIPSfpga+ system☆23Updated 4 years ago