MPSU / FPGA_practLinks
Методические материалы курса "Практикум по ПЛИС"
☆41Updated 7 months ago
Alternatives and similar repositories for FPGA_pract
Users that are interested in FPGA_pract are comparing it to the libraries listed below
Sorting:
- Открытое RISC-V процессорное ядро MIRISCV для образовательных целей☆23Updated last year
- Открытый ознакомительный курс "Введение в функциональную верификацию RISC-V ядер"☆47Updated 3 months ago
- Лабораторные работы по ЦОС (python)☆10Updated 9 months ago
- Полезные ресурсы по тематике FPGA / ПЛИС☆177Updated 3 months ago
- SystemVerilog language-oriented exercises☆56Updated last week
- Исходные коды к главам книги "Цифровой синтез: практический курс" (под ред. А.Ю. Романова и Ю.В. Панчула)☆63Updated 2 years ago
- FPGA exercise for beginners☆154Updated 2 weeks ago
- Методические материалы к лабораторным работам дисциплины "Проектирование цифровых устройств на языке Verilog"☆12Updated 2 years ago
- Репозиторий заданий и примеров направления функциональной верификации Школы синтеза цифровых схем☆21Updated 9 months ago
- Репозиторий факультатива по функциональной верификации НИУ МИЭТ☆16Updated last year
- DigitalDesignSchool2022/23 repository☆21Updated 3 years ago
- ☆48Updated 4 years ago
- Архитектуры процессорных систем (старый репозиторий, ранее размещавшийся по адресу github.com/MPSU/APS)☆97Updated 2 years ago
- human-in-the-loop HDL training tool☆40Updated last year
- FPGA exercise for beginners☆43Updated 3 months ago
- Mastering FPGASIC Book☆18Updated 3 months ago
- SystemVerilog language-oriented exercises☆142Updated last week
- CPU microarchitecture, step by step☆186Updated 3 years ago
- High speed C/C++ based behavioural VHDL/Verilog co-simulation memory model☆26Updated 6 months ago
- Учебные материалы Альянса RISC-V☆15Updated 7 months ago
- Verilog implementation of RISC-V: RV32IAC plus much of B. 32-bit or 16-bit bus.☆26Updated 2 years ago
- SDRAM controller for MIPSfpga+ system☆24Updated 5 years ago
- Fully pipelined Integer Scaled / Unscaled Radix-2 Forward/Inverse Fast Fourier Transform (FFT) IP-core for newest Xilinx FPGAs (Source la…☆86Updated 3 years ago
- Digital Design Labs☆25Updated 7 years ago
- An FPGA-based 7-ENOB 600 MSample/s ADC without any External Components☆47Updated 4 years ago
- Drawio => VHDL and Verilog☆61Updated 2 years ago
- ☆11Updated 2 years ago
- 🇯 JSON encoder and decoder in pure SystemVerilog☆12Updated last year
- A highly optimized streaming FFT core based on Bailey's 4-step large FFT algorithm☆127Updated 4 years ago
- A simple Verilog SPI master / slave implementation featuring all 4 modes.☆75Updated 5 years ago