DigitalDesignSchool / ce2020labs
ChipEXPO 2020 Digital Design School Labs
☆36Updated 2 years ago
Alternatives and similar repositories for ce2020labs:
Users that are interested in ce2020labs are comparing it to the libraries listed below
- Исходные коды к главам книги "Цифровой синтез: практический курс" (под ред. А.Ю. Романова и Ю.В. Панчула)☆54Updated last year
- SystemVerilog language-oriented exercises☆38Updated last month
- ☆47Updated 3 years ago
- Полезные ресурсы по тематике FPGA / ПЛИС☆157Updated 2 months ago
- DigitalDesignSchool2022/23 repository☆19Updated 2 years ago
- Открытый ознакомительный курс "Введение в функциональную верификацию RISC-V ядер"☆35Updated 3 months ago
- FPGA exercise for beginners☆32Updated this week
- FPGA exercise for beginners☆95Updated this week
- Репозиторий заданий и примеров направления функциональной верификации Школы синтеза цифровых схем☆15Updated 3 weeks ago
- Архитектуры процессорных систем (старый репозиторий, ранее размещавшийся по адресу github.com/MPSU/APS)☆93Updated 11 months ago
- CPU microarchitecture, step by step☆170Updated 2 years ago
- Методические материалы по разработке процессора архитектуры RISC-V☆162Updated this week
- Открытое RISC-V процессорное ядро MIRISCV для образовательных целей☆12Updated last month
- SystemVerilog language-oriented exercises☆58Updated 3 weeks ago
- Verilog (SystemVerilog) coding style☆40Updated 6 years ago
- Материалы для курсов "Введение в проектирование на языке Verilog" (2024+), "Введение в FPGA и Verilog" (2018-2019)☆93Updated 2 months ago
- Verilog implementation of RISC-V: RV32IAC plus much of B. 32-bit or 16-bit bus.☆24Updated last year
- Materials for the course "Embedded programming on STM32"☆164Updated last year
- ☆23Updated 4 years ago
- Digital Design Labs☆24Updated 6 years ago
- FPGA Logic Analyzer and GUI☆114Updated 2 years ago
- ☆41Updated last month
- An FPGA-based 7-ENOB 600 MSample/s ADC without any External Components☆42Updated 3 years ago
- open-source SDKs for the SCR1 core☆70Updated 2 months ago
- Testing FPGA2SDRAM interface on Altera Cyclone V SoC☆13Updated 9 years ago
- Учебные материалы Альянса RISC-V☆9Updated 2 months ago
- CPU microarchitecture, step by step☆193Updated 4 years ago
- ☆84Updated last year
- Using JTAG on STM32F103C8T6 to get device ID(IDCODE) and utilize other JTAG instructions such as BYPASS, EXTEST, SAMPLE/PRELOAD. Tera Ter…☆34Updated last year
- Contains source code for sin/cos table verification using UVM☆20Updated 3 years ago