NickolayTernovoy / risc-v_awesome_list
☆46Updated 3 years ago
Related projects ⓘ
Alternatives and complementary repositories for risc-v_awesome_list
- DigitalDesignSchool2022/23 repository☆19Updated last year
- Открытый ознакомительный курс "Введение в функциональную верификацию RISC-V ядер"☆32Updated last month
- SystemVerilog language-oriented exercises☆37Updated last week
- Открытое RISC-V процессорное ядро MIRISCV для образовательных целей☆11Updated 7 months ago
- ChipEXPO 2020 Digital Design School Labs☆35Updated last year
- Исходные коды к главам книги "Цифровой синтез: практический курс" (под ред. А.Ю. Романова и Ю.В. Панчула)☆53Updated last year
- FPGA exercise for beginners☆91Updated this week
- Полезные ресурсы по тематике FPGA / ПЛИС☆153Updated last year
- SystemVerilog language-oriented exercises☆46Updated last week
- Методические материалы по разработке процессора архитектуры RISC-V☆149Updated this week
- CPU microarchitecture, step by step☆164Updated 2 years ago
- Репозиторий заданий и примеров направления функциональной верификации Школы синтеза цифровых схем☆14Updated 3 weeks ago
- ☆23Updated 4 years ago
- Verilog implementation of RISC-V: RV32IAC plus much of B. 32-bit or 16-bit bus.☆21Updated last year
- Verilog (SystemVerilog) coding style☆39Updated 5 years ago
- Архитектуры процессорных систем (старый репозиторий, ранее размещавшийся по адресу github.com/MPSU/APS)☆93Updated 9 months ago
- Материалы для курсов "Введение в проектирование на языке Verilog" (2024+), "Введение в FPGA и Verilog" (2018-2019)☆92Updated this week
- FPGA exercise for beginners☆30Updated last week
- ☆11Updated last year
- human-in-the-loop HDL training tool☆33Updated 8 months ago
- Digital Design Labs☆23Updated 5 years ago
- High speed C/C++ based behavioural VHDL/Verilog co-simulation memory model☆22Updated 2 weeks ago
- ☆35Updated 2 years ago
- Mastering FPGASIC Book☆18Updated 2 years ago
- Syntacore first stage bootloader☆9Updated 2 years ago
- SDRAM controller for MIPSfpga+ system☆20Updated 4 years ago
- ☆40Updated last year
- Repository gathering basic modules for CDC purpose☆50Updated 4 years ago
- ☆53Updated 2 years ago
- Static Timing Analysis Full Course☆43Updated last year